Chillet, Daniel, 19..-...
![Sudoc [ABES], France](/viaf/images/flags/SUDOC.png "Sudoc [ABES], France")
Chillet, Daniel
VIAF ID: 32292529 (Personal)
Permalink: http://viaf.org/viaf/32292529
Preferred Forms
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Works
| Title | Sources |
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| Architectural design methodology of memories for circuits dedicated to real time signal processing. |
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| Architecture de l'ordinateur |
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| Compromis énergie-performance dans les réseaux optique sur puce. |
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| Conception de solutions de tolérance aux fautes à faible coût basées sur des structures approximées |
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| Contribution des systèmes sur puce basés sur FPGA pour les applications embarquées d'entraînement électrique |
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| Contribution of FPGA-based System-on-Chip controllers for embedded AC drive applications. |
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| Contributions à l’Ordonnancement en Temps Réel pour les Systèmes Autonomes en Energie. |
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| Contributions to Real Time Scheduling for Energy Autonomous Systems |
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| Définition d'un algorithme de localisation d'objets à partir de flux vidéos provenant de plusieurs caméras et évaluation sur MPSoC FPGA |
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| Définition et évaluation des stratégies d’ordonnancement spatio-temporel pour les architectures 3D multicore hétérogènes. |
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| Design of an adaptable embedded architecture for the deployment of brain-machine interface applications. |
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| Design of Low-Cost Fault-Tolerant Solutions based on Approximate Computing. |
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| Design process for the optimization of embedded software architectures on to multi-core processors in automotive industry. |
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| Développement d'un contrôleur dynamique de ressources allocation pour des FPGA partiellement reconfigurables. |
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| Energy-performance trade-off for optical network-on-chip |
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| Energy-Quality-Time Fault Tolerant Task Mapping on Multicore Architectures |
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| Executing secured virtual machines within a Manycore architecture. |
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| Exécution sécurisée de plusieurs machines virtuelles sur une plateforme Manycore |
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| Exploration architecturale et protocolaire pour les réseaux optiques sur puce 3D sous contraintes énergétiques. |
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| Un framework haut niveau pour l'estimation du temps d'exécution, des ressources matérielles et de la consommation d'énergie dans les accélérateurs à base de FPGA |
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| Génération automatique de modèle pour l'optimisation énergétique des systèmes cyber-physiques.. |
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| Hardware and software architecture facilitating the operation by the industry of dynamically adaptable heterogeneous embedded systems. |
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| High-level area-performance-energy estimation framework for FPGA-based accelerators. |
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| Improving Functional and Structural Test Solutions for Integrated Circuits. |
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| Intégration de technologies de mémoires non volatiles émergentes dans la hiérarchie de caches pour améliorer l'efficacité énergétique |
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| Investigation des techniques de surveillance pour les systèmes intégrés auto-adaptatifs. |
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| Investigation of monitoring techniques for self-adaptive integrated systems |
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| Mapping and scheduling strategy of OS tasks into reconfigurable architectures under energy constraint. |
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| Méthodes de Réduction de Ressources Matérielles Basées Calcul Approximé pour Systèmes Hétérogènes. |
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| Méthodes pour l’exploration rapide d’architectures multicœurs basées sur les réseaux sur puce avec des technologies émergentes. |
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| METHODOLOGIE DE CONCEPTION ARCHITECTURALE DES MEMOIRES POUR CIRCUITS DEDIES AU TRAITEMENT DU SIGNAL TEMPS REEL |
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| Methods for fast exploration of manycore architectures based network-on-chip with emerging technologies |
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| Modélisation, exploration et estimation de la consommation pour les architectures hétérogènes reconfigurables dynamiquement |
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| Multiple fault mitigation in network-on-chip architectures through a bit-shuffling method |
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| Non traduit. |
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| Performance and power consumption characterisation of embedded systems for multiprocessor/multicore platforms supporting real time software. : FORECAST : perFORmance and Energy Consumption AnalysiS Tool. |
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| Réseau sur puce, atténuation des défaillances, communication approximative, brassage de bits, défaillances permanentes multiples. |
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| RL-based Energy Management for Autonomous Cyber Physical Systems |
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| Runtime support for intermittent computing. |
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| Simulation accélérée par matériel et conception automatique d’architectures hétérogènes. |
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| Stratégie de placement et d'ordonnancement de taches logicielles pour architectures reconfigurables sous contrainte énergétique |
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| Stratégie de réduction des cycles thermiques pour systèmes temps-réel multiprocesseurs sur puce |
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| Study of an architectural model for code generation taking into account the real time constraints of an embedded system in the electrical measure and protection domain. |
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| Support d'exécution pour les systèmes intermittents |
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| Synthèse d'architectures de circuits FPGA tolérants aux défauts |
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| Test and characterization methodologies for advanced technology nodes |
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| Toward new Real-time operating system providing reliability for dynamically reconfigurable systems. |
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| Towards highly flexible hardware architectures for high-speed data processing : a 100 Gbps network case study |
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| Vers des architectures matérielles hautement flexibles pour le traitement des données à très haut débit : cas d'étude sur les réseaux à 100 Gbps. |
|
| Vers des nouveaux services RTOS offrant la fiabilisation des systèmes reconfigurable dynamiquement |
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| Virtualization of communications in a heterogeneous and dynamically reconfigurable platform. |
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