ANALYSE ET SYNTHESE D'ARCHITECTURES EN TRAITEMENT DU SIGNAL ET D'IMAGES : VERS LA CONCEPTION D'ARCHITECTURES HETEROGENES |
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Analytical precision evaluation of fixed-point systems. |
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Architectures analysis and synthesis in signal and image processing: towards heterogeneous architectures design. |
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Command unit for on chip parallel system : controller based on dynamically direct implementation on Petri nets. |
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Conception d'architectures compactes pour la détection spatiotemporelle d'actions en temps réel. |
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Conception d'un émetteur-récepteur de bande de base digital pour les architectures de réseau sur puce sans fil. |
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Contributions to fixed-point multiple word-length architecture synthesis. |
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Cooperative MIMO strategies for energy constrained wireless sensor networks |
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Design of a digital baseband transceiver for wireless network-on-chip architectures |
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Design of circuits in ternary logic : from characterization on the transistor level to architectural modeling. |
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Hardware architectures for WCDMA technology extended to multi-antenna systems. |
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Hiérarchie mémoire reconfigurable faible consommation pour systèmes enfouis |
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Implémentation efficace d'un codeur vidéo hiérarchique granulaire sur une architecture à processeurs multimedia |
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Improving the reliability of heterogeneous multicore architecture for intelligent transportation systems |
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Intégration des réseaux sur silicium : optimisation des preformances des couches physique et liaison |
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Lightweight architectures for spatiotemporal action detection in real-time |
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Local dynamic management of variability and power consumption in MPSoCs architectures. |
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Low-Complexity Parallel Algorithms and Scalable Architectures for Real-Time Coherent Optical OFDM Systems. |
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A low power reconfigurable memory hierarchy for embedded systems. |
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Méthode de partage de poids pour compresser des réseaux de neurones profonds sans réentraînement. |
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Méthodes d'évaluation du compromis précision-énergie pour le calcul approximatif niveau opérateur. |
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Méthodes et outils permettant le placement de taches efficaces en énergie sur architectures multicoeurs hétérogènes. |
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Méthodologie de compilation d'algorithmes de traitement du signal pour les processeurs en virgule fixe sous contrainte de précision |
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Methodology and tools for energy-aware task mapping on heterogeneous multiprocessor architectures |
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Methods to evaluate accuracy-energy trade-off in operator-level approximate computing |
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Microarchitectures pour la sauvegarde incrémentale, robuste et efficace dans les systèmes à alimentation intermittente. |
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Modèle et algorithme d'ordonnancement pour architectures reconfigurables dynamiquement |
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Modeling, design and characterization of delay-chains based true random number generator. |
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Modélisation, implémentation et caractérisation de circuits générateurs de nombres aléatoires vrais pour la certification de crypto-processeurs |
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Multisource systems for harvesting energy in the human environment : modeling and sizing optimization. |
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Network-on-Chip design : performance optimisation of physical and data layers. |
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Numerical accuracy optimization for energy consumption reduction in embedded systems. |
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Optimisation de la consommation énergétique sous contrainte de QoS pour des lunettes connectées intelligentes |
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Optimisation de la précision de calcul pour la réduction d'énergie des systèmes embarqués |
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Outils robustes pour l’approximation de Chebyshev pondérée et applications à la synthèse de filtres numériques. |
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Performance optimization mechanisms for fault-resilient VLIW processors |
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A performance projection approach for design-space exploration on Arm HPC environment. |
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Programmable Low Overhead, Run Length Limited and DC-Balanced Line Coding for High-Speed Serial Data Transmission. |
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Quantification et robustesse aux attaques adverses d’algorithmes neuronaux profonds embarqués. |
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Quantization and adversarial robustness of embedded deep neural networks |
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Read Only Data Specific Management for an Energy Efficient Memory System. |
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Réseau de service asynchrone pour contrôle distribué dans un circuit numérique ou mixte |
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Robust tools for weighted Chebyshev approximation and applications to digital filter design |
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Safety Evaluation of Aircraft Systems using Virtual Platforms. |
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SENTAUR. |
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Signal Integrity - Aware Pattern Generation for Delay Testing. |
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Simulation précise du mouvement des données au sein des systèmes mobiles multicœurs moderne. |
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Software design for flexible radio : integration of heterogeneous computing units. |
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Stochastic machines dedicated to Bayesian inference for source localization and separation. |
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Stratégies de MIMO coopératif pour les réseaux de capteurs sans fil contraints en énergie. |
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Study and optimization of dynamically reconfigurable architectures and processors coupling. |
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Support des compilateurs statiques et dynamiques pour les systèmes informatiques alimentés par intermittence. |
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Synthèse automatique d'accélérateurs matériels depuis des spécifications de haut niveau de formes d'ondes pour la radio flexible. |
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System-level approaches for fixed-point refinement of signal processing algorithms |
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System-level synthesis of ultra low-power wireless sensor network node controllers : a complete design-flow, anglais |
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Système de transmission radiofréquence adaptatif en performance et en consommation pour réseaux de capteurs autonomes en énergie. |
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Systèmes multisources de récupération d'énergie dans l'environnement humain : modélisation et optimisation du dimensionnement |
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Technique hybride d'estimation de puissance pour l’amélioration des modèles de puissance haut-niveau. |
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Test and reliability of Magnetic RAM (MRAM) memories. |
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Test et fiabilité des mémoires MRAM |
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TEST TECHNIQUES FOR APPROXIMATE DIGITAL CIRCUITS |
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Theoretical and experimental study of optical solutions for analog-to-digital conversion of high bit-rate signals |
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Theory and hardware implementation of probabilistic machines. |
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Tolérance aux fautes dans les implémentations matérielles des réseaux de neurones à impulsions. |
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Towards an energy-efficient platform for wireless sensor networks. |
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Towards compact, low energy and with adjustable accuracy Bayesian computers. |
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Towards compression at all levels in the memory hierarchy |
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Towards very high data rate uniform and Gaussian random nimbers generators. |
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Unité de commande pour systèmes parallèles : contrôleur basé sur la mise en oeuvre dynamique de réseaux de Pétri |
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Vers des calculateurs Bayésiens compacts, à faible énergie et à précision ajustable |
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Vers des générateurs de nombres aléatoires uniformes et gaussiens à très haut débit |
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Vers la compression à tous les niveaux de la hiérarchie de la mémoire. |
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Weight-sharing methods for retraining-free CNN compression |
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